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Æß¿þ¾î, ¼ÒÇÁÆ®¿þ¾î, FPGA, ±¤Çм³°è ¿¬±¸¿ø ä¿ë
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Æß¿þ¾î | ¨ç ¿µ»ó ó¸® ¾Ë°í¸®Áò ±¸Çö °³¹ß - Ä«¸Þ¶ó(IR/CCD/CMOS) ½Åȣó¸® ±¸Çö °³¹ß - µð¹ÙÀ̽º ¿¬µ¿ °³¹ß - ¿µ»óó¸® ¹× ³×Æ®¿öÅ© °³¹ß ¨è ARM °ü·Ã °³¹ß - Real-time ÇÁ·Î±×·¡¹Ö - °¢Á¾ µð¹ÙÀ̽º ¿¬µ¿/½ÅÈ£ ó¸® - FPGA ¿¬µ¿ ¹× ½Åȣó¸® ¾Ë°í¸®Áò °³¹ß - IP Ä«¸Þ¶ó ¾îÇø®ÄÉÀÌ¼Ç °³¹ß | [°æ·Â ¹× ÀÚ°Ý¿ä°Ç] - Çз : ÃÊ´ëÁ¹ ÀÌ»ó - Àü°ø : ÀÌ°ø°ú °è¿ ¿ì´ë - °æ·Â : 3³â ÀÌ»ó °æÇèÀÚ - C¾ð¾î È°¿ë´É·Â Çʼö [¿ì´ë»çÇ×] - ¿µ»óó¸® °ü¸® °³¹ß À¯ °æÇèÀÚ - ARM µî ÀÓº£µðµå °³¹ß °æÇèÀÚ - Ä«¸Þ¶ó ¼º´É Æò°¡ ¹× ÃøÁ¤ °³¹ß À¯ °æÇèÀÚ - OpenCV, OpenGL, OpenCL, CUDA »ç¿ë À¯°æÇèÀÚ - ±º¿ë ÀÓº£µðµå ½Ã½ºÅÛ °³¹ß °æÇè - RTOS/ÀÓº£µðµå ¸®´ª½º SW°³¹ß °æÇè - GIT/SVN µî ¹öÀü°ü¸®½Ã½ºÅÛ È°¿ë°æÇè | 0 ¸í |
¼ÒÇÁÆ®¿þ¾î | ¨ç ¿µ»óó¸® °ü·Ã ÇÁ·Î±×·¥ °³¹ß - ´ÙÁß Ä«¸Þ¶ó ±â¹Ý SW °³¹ß - ¿µ»ó ó¸® ¾Ë°í¸®Áò ±¸Çö °³¹ß - ¿µ»ó ÀúÀå/º¹¿ø/ºÐ¼® °³¹ß - ¿µ»ó ó¸® ¹× ÀúÀå ÇÁ·Î±×·¡¹Ö ¨è °¢Á¾ ÀåÄ¡ ¿¬µ¿¼ÒÇÁÆ®¿þ¾î °³¹ß - °¢Á¾ µð¹ÙÀ̽º ¿¬µ¿ ¼ÒÇÁÆ®¿þ¾î °³¹ß - °¢Á¾ ÀåÄ¡ ¿¬°á Å×½ºÆ® ¼ÒÇÁÆ®¿þ¾î °³¹ß | [°æ·Â ¹× ÀÚ°Ý¿ä°Ç] - Çз : ÃÊ´ëÁ¹ ÀÌ»ó - Àü°ø : ÀÌ°ø°ú °è¿ ¿ì´ë - °æ·Â : 3³â ÀÌ»ó °æÇèÀÚ - C/C++±â¹Ý ½Ã½ºÅÛ °³¹ß °æÇèÀÚ [¿ì´ë»çÇ×] - Ä«¸Þ¶ó °³¹ß À¯°æÇèÀÚ - ¸®´ª½º °³¹ß ȯ°æ À¯ °æÇèÀÚ - GPU »ç¿ë À¯ °æÇèÀÚ - H.264/H.265 ó¸® °æÇèÀÚ | 0 ¸í |
FPGA | ¨ç Ä«¸Þ¶ó °ü·Ã Çϵå¿þ¾î/IP °³¹ß - 2D ¼¾¼ ½Åȣó¸® ±¸µ¿È¸·Î °³¹ß - Ä«¸Þ¶ó(IR/Visible) ½Åȣó¸® °³¹ß - FPGA/AP °ü·Ã Çϵå¿þ¾î ¼³°è °³¹ß ¨è ¿µ»óó¸® IP °³¹ß - Noise/Enhancement Filters - Sensor/Optics Corrections - Camera/video/display Interfacing - AutoFocus µî | [°æ·Â ¹× ÀÚ°Ý¿ä°Ç] - Çз : ÃÊ´ëÁ¹ ÀÌ»ó - Àü°ø : ÀÌ°ø°ú °è¿ ¿ì´ë - °æ·Â : 5³â ÀÌ»ó °æÇèÀÚ [¿ì´ë»çÇ×] - °¢Á¾ ¿µ»óó¸® ·ÎÁ÷ ¼³°è/°³¹ß °¡´ÉÀÚ - ¾Æ³¯·Î±× ¼¾¼ ±¸µ¿ °³¹ß °æ·ÂÀÚ | 0 ¸í |
±¤Çм³°è | ¨ç ±¤ÇÐ ¼³°è(°á»ó±¤ÇÐ°è ¼³°è, Àû¿Ü¼± ·»Áî ¼³°è) ¨è ±¤Çаè Á¶¸³Æò°¡ |
[°æ·Â ¹× ÀÚ°Ý¿ä°Ç] - Çз : ÃÊ´ëÁ¹ ÀÌ»ó - Àü°ø : ÀÌ°ø°ú °è¿ ¿ì´ë - °æ·Â : ±¤Çм³°è °æ·Â 3³â ÀÌ»ó - °á»ó±¤ÇÐ°è ¼³°è °æÇèÀÚ - CodeV ¶Ç´Â Zamax ¼³°è °æ·Â - ÁÜ ±¤ÇÐ°è ¼³°è ¾÷¹« °æ·ÂÀÚ [¿ì´ë»çÇ×] - ·¹ÀÌÀú ±¤ÇÐ°è ¼³°è ¾÷¹« °æ·ÂÀÚ |
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2024-05-18 (Åä) 23½Ã59ºÐ±îÁö
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