• 개발된 HW IP의 value-added 기능 설계(RTL coding)및 검증(simulation and synthesis) 및 유지 보수

• 개발 중인 HW IP에 대한 검증 환경 setup 및 Debugging

• 개발 완료된 Product에 대한 Customer 지원

• 전자(공학)과 출신(학사 or 석사)

• Verilog & C 기본 지식 보유

• Python/Perl/JAVA/Shell script에 대한 지식 보유

• Video Codec에 대한 지식 보유

• FPGA Development Environment 경험

• 영어 활용 가능자

• 유연근무 (Core time 운영 11:30 ~ 15:30)

• 점심/저녁 지원

• 선택적복리후생비 연 300만원 제공

• Refresh 휴가 및 휴가비 지원

• 연 70만원 상당 건강검진 제공

• 사내 세미나 활성화 등 개발 역량 향상을 위한 지원

• 영어 닉네임 사용

• 학사 신입기준 연봉 5000만원

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