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PCIe IP Integration   ¤Ó  0¸í

ÁÖ¿ä¾÷¹«
¤ý PCIe IP Configuration/Integration ¹× SoC ¼³°è Áö¿ø
¤ý SoC °ËÁõ ¹× Controller IP/Subsystem Spe ±â¹Ý RTL °ËÁõ
¤ý SoC Sub-system ¼³°è ¹× Integration
¤ý PCIe Æ÷ÇÔ SoC ¾ç»ê ¹× Å×½ºÆ® Áö¿ø
¤ý FPGA ÇÁ·ÎÅäŸÀÌÇΠ¹× Silicon Bring-up °ü·Ã °æÇè ¿ì´ë

Áö¿øÀÚ°Ý
¤ýPCIe IP Integration °æÇè 3³â ÀÌ»ó
¤ýSoC ¼³°è °æÇè 7³â ÀÌ»ó
¤ýSoC IP °ËÁõ(VIP, UVM µî) °æÇè
¤ýARM Core ¹× AMBA Bus¿¡ ´ëÇÑ ÀÌÇØ
¤ýPCIe Æ÷ÇÔ SoC ¾ç»ê/Å×½ºÆ® °æÇè ¿ì´ë

¿ì´ë»çÇ×
¤ýSoC ¼³°èÆÀ ¸®µå °æÇè
¤ýHigh-Speed Interface IP(DDR, USB, UFS, SD/eMMC µî) °ËÁõ ¹× ÃÖÀûÈ­
¤ýº¸µå ¼³°è ¿£Áö´Ï¾î ¹× Implementation °ü·Ã ÆÀ¿ø°úÀÇ ¿øÈ°ÇÑ Çù¾÷ °æÇè ¿ì´ë

±Ù¹«Á¶°Ç
¤ý    ±Ù¹«ÇüÅ    :    Á¤±ÔÁ÷(¼ö½À±â°£)-3°³¿ù
¤ý    ±Ù¹«ÀϽà   :    ÁÖ 5ÀÏ(¿ù~±Ý)
¤ý    ±Ù¹«Áö¿ª    :    (06162) ¼­¿ï °­³²±¸ Å×Çì¶õ·Î 407 ÀÌÄÉÀÌŸ¿ö 11Ãþ(»ï¼ºµ¿) - ¼öÀκд缱 ¼±¸ª ¿¡¼­ 200m À̳»